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      《普通高等教育“十二五”電子信息類(lèi)規(guī)劃教材：基于QuartusII的CPLD的數(shù)字系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)》是山東省精品課程“電子技術(shù)”的配套教材之一，第1章介紹了QuartusⅡ9?X的開(kāi)發(fā)流程，第2章介紹了CPLD的相關(guān)知識(shí)，第3章介紹門(mén)電路的實(shí)現(xiàn)方法，第4章介紹組合邏輯電路，第5章介紹了組合邏輯電路的應(yīng)用，第6章介紹了觸發(fā)器的知識(shí)，第7章介紹了時(shí)序邏輯電路，第8章介紹了時(shí)序邏輯電路的設(shè)計(jì)及應(yīng)用，第9章是基于原理圖的綜合設(shè)計(jì)實(shí)例，第10章是基于混合輸入的綜合設(shè)計(jì)。
　　《普通高等教育“十二五”電子信息類(lèi)規(guī)劃教材：基于QuartusII的CPLD的數(shù)字系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)》可作為高等院校自動(dòng)化、電子信息、計(jì)算機(jī)及其他相關(guān)專(zhuān)業(yè)的教材，也可供從事電子設(shè)計(jì)的工程技術(shù)人員參考。

前言
第1章Quartus Ⅱ 9X開(kāi)發(fā)流程1
11Quartus Ⅱ概述1
12面向FPGA/CPLD的開(kāi)發(fā)流程3
121設(shè)計(jì)輸入3
122綜合4
123布線布局(適配)4
124仿真5
125下載和硬件測(cè)試5
13Quartus Ⅱ操作流程5
131創(chuàng)建工程5
132設(shè)計(jì)文件輸入7
133編譯前設(shè)置9
134全程編譯10
135時(shí)序仿真11
136RTL級(jí)電路15
137引腳鎖定16
138編程下載17
139其他下載方式18
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